(1998) A Hardware model of an expandable RSA cryptographic system. Masters thesis, King Fahd University of Petroleum and Minerals.

Preview

PDF 9933.pdf Download (3MB) | Preview

Arabic Abstract

التشفير (Cryptography) هو الأسلوب الأمثل لحماية المعلومات والحفاظ على سريتها . وأحد أنجح طرق التشفير المستخدمة يعرف بـ (RSA) ، وهي الطريقة التي تعتمد على حجم مفتاح الشفرة لتعقيد استنباط الرسالة الأساسية في وقت قصير ، وتعاني طريقة (RSA) من سلبية في تصميمها بالدوائد الإلكترونية الدقيقة ، وهي أن أدوائر المصممة للتشفير بمفتاح ذو حجم معين ثابت ، لو تغير لاحتاج تغيير التصميم الإلكتروني بالكليـّة . وقد تم في هذا البحث تصميم طريقة جديدة مبنية على فكرة تطوير الدائرة الإلكترونية الدقيقة حسب الحاجة ، بحيث تم تمثيل هذا التصميم باستعمال نموذج محاكاة التصميم الإلكتروني باستخدام لغة (VHDL) ، وقورن هذا النموذج بالتفصيل مع تصميمين آخرين أيضاً باستخدام (VHDL) ، وأثبت التصميم المقترح تفوقاً في السرقة بالرغم من أنه يعتبر الأكبر مساحة . وقـد تـم إجـراء مـقـارنـة بـيـن الـتصاميـم الثـلاثـة من حيث كفاءة لاأداء والسرعة التكلفة (التكلفة = المساحة × السرعة 2) ، وأظهر التصميم المقترح نتائج مقاربة لأفضل تصميم . واعتبرت زيادة التكلفة نوع من الثمن مقابل للمرونة المتوفرة في هذا التصميم ولاتي تجعله قابل للتطوير حسب حاجة المستخدم .

English Abstract

Data security is an important aspect of information transmission and storage in an electronic form. Cryptographic systems are used to encrypt such information to guarantee its security. To retrieve such information, the encrypted form must be first decrypted. One of the most popular cryptographic systems is the RSA system. The security of the RSA-encrypted information largely depends on the size of the used encryption key. The larger the key size is the longer the encryption/decryption time will be. To cope with the continuous demand for larger key sizes, faster hardware implementations of the RSA algorithm has become an active area of research. One disadvantage of hardware implementations is their fixed key sizes. If the key size is to be increased, the hardware design should be fully replaced. The work reported here proposes an RSA hardware implementation that can be expanded as the key size gets larger. This implementation is modeled using VHDL in a parametrizable manner. Two other parameterized RSA hardware designs have also been VHDL modeled for comparison. The three models are compared for a 1024-bit key size and the results are analyzed. The complexity of the designs are compared and conclusions regarding optimal delay and area parameters are made.

Item Type:	Thesis (Masters)
Subjects:	Computer
Department:	College of Computing and Mathematics > Computer Engineering
Committee Advisor:	Amin, M. B.
Committee Members:	Elleithy, Khaled M. and Al-Tawil, Khalid M.
Depositing User:	Mr. Admin Admin
Date Deposited:	22 Jun 2008 13:52
Last Modified:	01 Nov 2019 13:53
URI:	http://eprints.kfupm.edu.sa/id/eprint/9933